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参考(kao)设(she)想流程(cheng)

参(can)考设想流程

中芯国际(ji)供给(ji)基于差别(bie)前(qian)沿EDA处(chu)理(li)计划的(de)多个综合参考流(liu)(liu)程。这些(xie)参考流(liu)(liu)程使客户成立起(qi)本身的(de)设想情况,经(jing)由过程从RTL到GDSII的(de)简(jian)略(lve)步骤(zhou),大(da)大(da)削减了出产时(shi)候。

这些(xie)参(can)考流程是由中芯国际的(de)(de)参(can)考流程团队(dui)及Cadence,Synopsys等抢先的(de)(de)EDA公司配合开辟的(de)(de)。

今朝,中芯国(guo)际(ji)供给基于差(cha)别的(de)EDA设(she)(she)想情(qing)况(kuang)的(de)逻辑设(she)(she)想和庞杂的(de)体系芯片参考(kao)设(she)(she)想流程(cheng),办事于0.13μm,90nm,65nm,40nm及28nm的(de)设(she)(she)想。也包罗(luo)针对0.11μM和55nm的(de)参考(kao)设(she)(she)想指南。

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文件

版本

 

28um

SMIC- Cadence Reference Flow 6.0

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SMIC- Synopsys Reference Flow 6.0

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40um

SMIC- Cadence Reference Flow 5.1

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SMIC- Synopsys Reference Flow 5.1

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65um

SMIC- Cadence Reference Flow 4.0

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SMIC- Synopsys Reference Flow 4.0

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90um

SMIC- Cadence Reference Flow 3.2

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SMIC- Synopsys Reference Flow 3.2

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0.13um

SMIC- Cadence Reference Flow 2.1

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SMIC- Synopsys Reference Flow 2.1

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其余设想撑持(chi)

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